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Zeitschriftenartikel

A Fault-Tolerant Processor Architecture

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Datum

2010

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Bandtitel

Quelle

FERS-Mitteilungen: Vol. 28, No. 1

Verlag

Gesellschaft für Informatik e.V.

Zusammenfassung

Beschreibung

Bouajila, Abdelmajid; Sommer, Thomas; Zeppenfeld, Johannes; Stechele, Walter; Herkersdorf, Andreas (2010): A Fault-Tolerant Processor Architecture. FERS-Mitteilungen: Vol. 28, No. 1. DOI: 10.1007/BF03345438. Gesellschaft für Informatik e.V.. PISSN: 0724-5319. pp. 14-19

Schlagwörter

Register File , Fault Injection , Soft Error , RISC Processor , Superscalar Processor

Zitierform

DOI

10.1007/BF03345438

Tags

Sammlungen

FERS-Mitteilungen 28(1) - 2010